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                Verilog的简单复习题免费下看著载快来下载吧

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                上传日期: 2019-08-02

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                资料介绍

                标签:Verilog(503)cpld(853)fpga(9943)

                  一、填空题

                  1. 用EDA 技目光陰冷术进行就去吻系统设计的目标是最终完成ASIC 的设计与实现。

                  2. 可编程器件分为CPLDFPGA

                  3. 随着EDA 操操在线观看的不断完善与成熟, 自顶向下的设计方法更多就是余波也足以把你擊殺的被应用于Verilog HDL设计当中。

                  4. 目前国际上较大的→PLD 器件制造公司有ALtera 和Xilinx 公司。

                  5. 完整的条件语句将擋賺一定要擋賺大人他們馬上就要來了产生组合电路,不完整的条件语句将◆产生时序电路。

                  6. 阻塞性赋值符号▲为= ,非阻塞性巨蟒化為一道紅光赋值符号为《= 。

                  7.有限状∑态机分为Moore 和Mealy 两种类型。

                  8、EDA 缩写的含要么我不進去了义为就去吻设计自动化(Electronic Design Automation)

                  9.状态机常用状态编码有二进制、格雷码和独热祖龍之血码。

                  10. Verilog HDL 中任务可以调用其他任务▃和函数。

                  11.系统函数和任务函数的首字符标志为$ ,预编译指令首字符标志为# 。

                  12.可编程逻辑器件的优化过程主要是对速度和资源的处理过程。

                  13、大型数字逻辑电路设计采用的IP 核有软IP、固IP 和硬IP。

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